高速ADC

<strong><font color="#004a85">作者： Youbok Lee 博士（Microchip Technology Inc.）</font> </strong>

近年来，数字射频接收器技术取得了巨大进步，这主要得益于高速 ADC 的出现。直接转换、中频采样以及软件定义的无线电架构开始在现代射频接收器设计中普及。

由于芯片生产和 ADC 设计技术的不断进步，现在 ADC中也包含许多以前在独立器件中使用或者通过软件实现的数字信号处理（Digital Signal Processing，DSP）功能......

<strong><font color="#FF0000">问题:高速ADC为什么有如此多电源域？</font></strong>

<strong><font color="#FF0000">答案:</font> </strong>

在采样速率和可用带宽方面，当今的射频模数转换器(RF ADC)已有长足的发展。其中还纳入了大量数字处理功能，电源方面的复杂性也有提高。那么，当今的RF ADC为什么有如此多不同的电源轨和电源域？

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<strong>问题:</strong>

<strong>高速ADC为什么有如此多电源域？</strong>

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<strong>答案:</strong>

在采样速率和可用带宽方面，当今的射频模数转换器(RF ADC)已有长足的发展。其中还纳入了大量数字处理功能，电源方面的复杂性也有提高。那么，当今的RF ADC为什么有如此多不同的电源轨和电源域？

作者：Jonathan Harris，ADI公司应用工程师

<strong>简介</strong>

随着高速ADC跨入GSPS范围，与FPGA(定制ASIC)进行数据传输的首选接口协议是JESD204B。为了捕捉频率范围更高的RF频谱，需要宽带RF ADC。在其推动下，对于能够捕捉更宽带宽并支持配置更灵活的SDR(软件定义无线电)平台的GSPS ADC，高速串行接口(在此情况下即JESD204B)是必不可少的。JESD204B标准是一种分层规范，了解这一点很重要。规范中的各层都有自己的功能要完成。应用层支持JESD204B链路的配置和数据映射。传输层实现转换样本与成帧未加扰八位字之间的映射。加扰层可以选择性地获取八位字并进行加扰或解扰，以便通过延展频谱尖峰来降低EMI效应。加扰在发送器中完成，解扰在接收器中完成。在数据链路层中，可选加扰的八位字编码成10位字符。该层也是产生或检测控制字符的地方，目的是监视和维护通道对齐。物理层即串行器/解串器(SERDES)层，负责以线路速率发送或接收字符。该层包括串行器、驱动器、接收器、时钟和数据恢复电路。图1显示了这些层在JESD204B中的安排。为了更好地理解该规范，详细阐释各层对了解ADC样本如何映射到8B/10B串行字是有好处的。

<strong>简介：</strong>

多数现代高性能ADC都利用差分输入来抑制共模噪声及干扰，将动态范围提高2倍，并通过平衡信号提高总体性能。尽管带差分输入的ADC可以接受单端输入信号，但在输入差分信号时，ADC的性能达到最佳状态。ADC驱动器-通常设计用于提供此此类信号的电路-执行多种重要功能，包括幅度缩放、单端-差分转换、缓冲、共模失调调整、滤波等。

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应用范围：本应用笔记将介绍ADI公司高速转换器部门用来评估高速ADC的特征测试和生产测试方法。本应用笔记仅供参考，不能替代产品数据手册。